HDLによるLSI開発技術(Verilog-HDL Intel編)<FPGA開発シリーズ1C> | 【長野県】キャリアアップステーションNAGANO

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「講座・研修」詳細

講座
研修
講座名

HDLによるLSI開発技術(Verilog-HDL Intel編)<FPGA開発シリーズ1C>

開催期間

2026/06/10〜2026/06/12
10:00~16:45

開催日数

3日

募集期間

〜2026/05/27

開催場所

高度ポリテクセンター  千葉市美浜区若葉3-1-2 

受講料

30,000円

対象者

Verilog-HDLによるFPGA開発担当者

定員

14名

内容

FPGAの評価ボードを用いた実習を通じて、Verilog-HDLによるFPGA開発技術を習得できます。FPGAの設計フロー及び文法事項と設計手順を理解し、評価ボードにデジタル回路を設計することにより、実務レベルで役立つVerilog-HDL記述によるハードウェア設計手法を習得できます。

詳細はお問い合わせください

詳細情報URL

https://www.apc.jeed.go.jp/zaishoku/2026/T0911.html


問い合わせ先

高度ポリテクセンター

URL
https://www.apc.jeed.go.jp/
電話番号

043-296-2582

FAX番号

043-296-2585

Mail

kodo-poly02@jeed.go.jp


講座・研修
カテゴリー

デジタル(その他)、ものづくり(電気・電子)

ID:118720

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